問答題簡述用譯碼器或多路選擇器實現(xiàn)組合邏輯電路的不同之處。
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1.單項選擇題用原碼輸出的譯碼器實現(xiàn)多輸出邏輯函數(shù)，需要增加若干個（）。
A.非門
B.與非門
C.或門
D.或非門
2.單項選擇題利用2個74LS138和1個非門，可以擴展得到1個（）線譯碼器。
A.2-4
B.3-8
C.4-16
D.無法確定
3.單項選擇題10-4線優(yōu)先編碼器允許同時輸入（）路編碼信號。
A.1
B.9
C.10
D.多
4.單項選擇題TTL與非門輸入短路電流IIS的參數(shù)規(guī)范值是（）。
A.20μA
B.40μA
C.1.6mA
D.16mA
5.單項選擇題TTL與非門閾值電壓UT的典型值是（）
A.0.4V
B.1.4V
C.2V
D.2.4V
6.單項選擇題TTL與非門輸出低電平的參數(shù)規(guī)范值是（）
A.Uol≤0.3V
B.Uol≥0.3V
C.Uol≤0.4V
D.Uol=0.8V
7.單項選擇題TTL與非門輸出高電平的參數(shù)規(guī)范值是（）
A.Uoh≥1.4V
B.Uoh≥2.4V
C.Uoh≥3.3V
D.Uoh=3.6V
10.問答題簡述VHDL語言的主要優(yōu)點。
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