單項(xiàng)選擇題用原碼輸出的譯碼器實(shí)現(xiàn)多輸出邏輯函數(shù)，需要增加若干個(gè)（）。
A.非門
B.與非門
C.或門
D.或非門
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1.單項(xiàng)選擇題利用2個(gè)74LS138和1個(gè)非門，可以擴(kuò)展得到1個(gè)（）線譯碼器。
A.2-4
B.3-8
C.4-16
D.無(wú)法確定
2.單項(xiàng)選擇題10-4線優(yōu)先編碼器允許同時(shí)輸入（）路編碼信號(hào)。
A.1
B.9
C.10
D.多
3.單項(xiàng)選擇題TTL與非門輸入短路電流IIS的參數(shù)規(guī)范值是（）。
A.20μA
B.40μA
C.1.6mA
D.16mA
4.單項(xiàng)選擇題TTL與非門閾值電壓UT的典型值是（）
A.0.4V
B.1.4V
C.2V
D.2.4V
5.單項(xiàng)選擇題TTL與非門輸出低電平的參數(shù)規(guī)范值是（）
A.Uol≤0.3V
B.Uol≥0.3V
C.Uol≤0.4V
D.Uol=0.8V
6.單項(xiàng)選擇題TTL與非門輸出高電平的參數(shù)規(guī)范值是（）
A.Uoh≥1.4V
B.Uoh≥2.4V
C.Uoh≥3.3V
D.Uoh=3.6V
7.問答題一個(gè)VHDL模塊是否必須有一個(gè)實(shí)體和一個(gè)結(jié)構(gòu)體？是否可以有多個(gè)實(shí)體和結(jié)構(gòu)體？簡(jiǎn)述它們的作用。
10.單項(xiàng)選擇題在VHDL語(yǔ)言中，變量的賦值符是（）。
A.=
B.：=
C.＜=
D.==
最新試題
TTL與非門輸出低電平的參數(shù)規(guī)范值是（）
題型：?jiǎn)雾?xiàng)選擇題
小容量RAM內(nèi)部存儲(chǔ)矩陣的字?jǐn)?shù)與外部地址線數(shù)n的關(guān)系一般為（）
題型：?jiǎn)雾?xiàng)選擇題
電可擦除的PROM器件是（）
題型：?jiǎn)雾?xiàng)選擇題
7系列EPROM存儲(chǔ)的數(shù)據(jù)是（）可擦除的。
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如要將一個(gè)最大幅度為5.1V的模擬信號(hào)轉(zhuǎn)換為數(shù)字信號(hào)，要求輸入每變化20mV，輸出信號(hào)的最低位（LSB）發(fā)生變化，應(yīng)選用（）位ADC。
題型：?jiǎn)雾?xiàng)選擇題
一個(gè)兩輸入端的門電路，當(dāng)輸入為10時(shí)，輸出不是1的門電路為（）
題型：?jiǎn)雾?xiàng)選擇題
雙積分型數(shù)字電壓表是否需要取樣-保持電路？請(qǐng)說(shuō)明理由。
題型：?jiǎn)柎痤}
TTL與非門輸入短路電流IIS的參數(shù)規(guī)范值是（）。
題型：?jiǎn)雾?xiàng)選擇題
若停電數(shù)分鐘后恢復(fù)供電，（）中的信息能夠保持不變。
題型：?jiǎn)雾?xiàng)選擇題
用原碼輸出的譯碼器實(shí)現(xiàn)多輸出邏輯函數(shù)，需要增加若干個(gè)（）。
題型：?jiǎn)雾?xiàng)選擇題