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單項(xiàng)選擇題TTL與非門(mén)閾值電壓UT的典型值是（）

A.0.4V
B.1.4V
C.2V
D.2.4V

1.單項(xiàng)選擇題TTL與非門(mén)輸出低電平的參數(shù)規(guī)范值是（）

A.Uol≤0.3V
B.Uol≥0.3V
C.Uol≤0.4V
D.Uol=0.8V

2.單項(xiàng)選擇題TTL與非門(mén)輸出高電平的參數(shù)規(guī)范值是（）

A.U_oh≥1.4V
B.U_oh≥2.4V
C.U_oh≥3.3V
D.U_oh=3.6V

3.問(wèn)答題一個(gè)VHDL模塊是否必須有一個(gè)實(shí)體和一個(gè)結(jié)構(gòu)體？是否可以有多個(gè)實(shí)體和結(jié)構(gòu)體？簡(jiǎn)述它們的作用。

4.問(wèn)答題判斷如下VHDL的操作是否正確，如不正確，請(qǐng)改正。字符a和b的數(shù)據(jù)類(lèi)型是BIT，c是INTEGER，執(zhí)行c＜=a+b。

5.問(wèn)答題簡(jiǎn)述VHDL語(yǔ)言的主要優(yōu)點(diǎn)。

6.單項(xiàng)選擇題在VHDL語(yǔ)言中，變量的賦值符是（）。

A.=
B.：=
C.＜=
D.==

7.單項(xiàng)選擇題在VHDL語(yǔ)言中，信號(hào)賦值語(yǔ)句使用的代入符是（）

A.=
B.：=
C.＜=
D.==

8.單項(xiàng)選擇題在VHDL語(yǔ)言中，不同類(lèi)型的數(shù)據(jù)是（）的。

A.可以進(jìn)行運(yùn)算和直接代入
B.不能進(jìn)行運(yùn)算和直接代入
C.不能進(jìn)行運(yùn)算但可以直接代入
D.可以進(jìn)行運(yùn)算但不能直接代入

9.單項(xiàng)選擇題VHDL中的各種邏輯運(yùn)算中，運(yùn)算符（）的優(yōu)先級(jí)別最高。

A.AND
B.OR
C.XOR
D.NOT

10.單項(xiàng)選擇題結(jié)構(gòu)體中的變量應(yīng)在VHDL程序中（）部分給予說(shuō)明。

A.結(jié)構(gòu)體對(duì)應(yīng)的實(shí)體的端口表中
B.結(jié)構(gòu)體中關(guān)鍵詞BEGIN前
C.結(jié)構(gòu)體中關(guān)鍵詞BEGIN后
D.程序包（PACKAGE）