A.根據(jù)給定的邏輯圖寫出輸出邏輯函數(shù)表達(dá)式
B.化簡(jiǎn)函數(shù)表達(dá)式
C.列出真值表
D.根據(jù)最簡(jiǎn)輸出函數(shù)表達(dá)式畫出邏輯圖
您可能感興趣的試卷
你可能感興趣的試題
A.加法器
B.比較器
C.譯碼器
D.數(shù)據(jù)選擇器
A.真值表
B.卡諾圖
C.邏輯表達(dá)式
D.時(shí)序圖
A.由常用門電路組合而成
B.無輸出到輸入的反饋連接
C.不包含可以存儲(chǔ)信號(hào)的記憶元件
D.輸出只由輸入決定
A.邏輯競(jìng)爭(zhēng)
B.臨界競(jìng)爭(zhēng)
C.非臨界競(jìng)爭(zhēng)
D.功能競(jìng)爭(zhēng)
A.級(jí)連法
B.擴(kuò)展法
C.降維法
D.重新選擇器件，使m＝n
A.譯碼器
B.數(shù)據(jù)選擇器
C.數(shù)值比較器
D.加法器
A.SSI
B.MSI
C.LSI
D.VLSI
A.二進(jìn)制譯碼器
B.數(shù)據(jù)選擇器
C.數(shù)值比較器
D.七段顯示譯碼器
A.修改邏輯設(shè)計(jì)
B.在輸出端接入濾波電容
C.后級(jí)加緩沖電路
D.屏蔽輸入信號(hào)的尖峰干擾
A.十進(jìn)制
B.二進(jìn)制
C.八進(jìn)制
D.十六進(jìn)制
最新試題
27系列EPROM存儲(chǔ)的數(shù)據(jù)是（）可擦除的。
以下哪個(gè)編碼不能是二－十進(jìn)制譯碼器的輸入編碼（）
與倒T形電阻網(wǎng)絡(luò)DAC相比，權(quán)電流網(wǎng)絡(luò)D/A轉(zhuǎn)換器的主要優(yōu)點(diǎn)是消除了（）對(duì)轉(zhuǎn)換精度的影響。
兩個(gè)與非門構(gòu)成的基本RS觸發(fā)器，當(dāng)Q=1、Q=0時(shí)，兩個(gè)輸入信號(hào)R=1和S=1。觸發(fā)器的輸出Q會(huì)（）。
試提出數(shù)字頻率計(jì)的三種設(shè)計(jì)方案，比較各種方案的特點(diǎn)。如果用HDPLD來實(shí)現(xiàn)，設(shè)計(jì)方案是最佳嗎？簡(jiǎn)述理由。
用原碼輸出的譯碼器實(shí)現(xiàn)多輸出邏輯函數(shù)，需要增加若干個(gè)（）。
電可擦除的PROM器件是（）
ROM可以用來存儲(chǔ)程序、表格和大量固定數(shù)據(jù)，但它不可以用來實(shí)現(xiàn)（）。
什么是觸發(fā)器的空翻現(xiàn)象，如何避免空翻？
一個(gè)兩輸入端的門電路，當(dāng)輸入為10時(shí)，輸出不是1的門電路為（）