單項(xiàng)選擇題用原碼輸出的譯碼器實(shí)現(xiàn)多輔出邏輯函數(shù),需要增加若于個(gè)()。

A.非門
B.與非門
C.或門
D.或非門


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1.單項(xiàng)選擇題利用2個(gè)74LSl38和1個(gè)非門,可以擴(kuò)展得到1個(gè)()線譯碼器。

A.2—4
B.3—8
C.4—16
D.無(wú)法確定。

2.單項(xiàng)選擇題74LS138有()個(gè)譯碼輸入端和()個(gè)譯碼輸出端。

A.1,3
B.3,8
C.8,3
D.無(wú)法確定

4.單項(xiàng)選擇題在設(shè)計(jì)過(guò)程中,邏輯函數(shù)化簡(jiǎn)的目的是()。

A.獲得最簡(jiǎn)與或表達(dá)式
B.用最少的邏輯器件完成沒(méi)計(jì)
C.用最少的集電門完成設(shè)計(jì)
D.獲得最少的與項(xiàng)

5.單項(xiàng)選擇題組合電路設(shè)計(jì)的結(jié)果一般是要得到()。

A.邏輯電路圖
B.電路的邏輯功能
C.電路的真值表
D.邏輯函數(shù)式

6.單項(xiàng)選擇題組合電路分析的結(jié)果是要獲得()。

A.邏輯電路圖
B.電路的邏輯功能
C.電路的真值表
D.邏輯函數(shù)式

7.單項(xiàng)選擇題門級(jí)組合電路是指的電路()。

A.由二、三極管開(kāi)關(guān)組成
B.由各種門電路組成且無(wú)反饋線
C.由組合器件組成
D.由各種數(shù)字集成電路組成

8.單項(xiàng)選擇題電源電壓VDD為10V的CMOS集成模擬開(kāi)關(guān)可按通幅度為()的信號(hào)。

A.-10~0V
B.0—10V
C.0—VDD/2
D.>10V

9.單項(xiàng)選擇題不屬于CMOS邏輯電路優(yōu)點(diǎn)的提法是()。

A.輸出高低電平理想
B.電源適用范圍寬
C.抗干擾能力強(qiáng)
D.電流驅(qū)動(dòng)能力強(qiáng)

10.單項(xiàng)選擇題CMOS系列產(chǎn)品中,工作速度低于74系列TTL的是()系列。

A.74HC
B.74HCT
C.54HC
D.4000B