A.接邏輯“1”
B.接邏輯“0”
C.接2.4V電壓
D.邏輯不定
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A.接邏輯“1”
B.接邏輯“0”
C.接2.4V電壓
D.邏輯不定
A.3kΩ
B.2kΩ
C.700Ω
D.300Ω
A.固定接0
B.固定接1
C.同時(shí)使能
D.分時(shí)使能
A.異或門
B.OC門
C.TS門
D.與或非門
A.30
B.20
C.15
D.10
A.200uA
B.400uA
C.800uA
D.1000uA
A.20uA
B.40uA
C.1.6mA
D.16mA
A.20uA
B.40uA
C.1.6mA
D.16mA
A.20uA
B.40uA
C.1.6mA
D.16mA
A.0.4V
B.1.4V
C.2V
D.2.4V
最新試題
判斷如下VHDL的操作是否正確,如不正確,請(qǐng)改正。字符a和b的數(shù)據(jù)類型是BIT,c是INTEGER,執(zhí)行c<=a+b。
簡(jiǎn)述用譯碼器或多路選擇器實(shí)現(xiàn)組合邏輯電路的不同之處。
10-4線優(yōu)先編碼器允許同時(shí)輸入()路編碼信號(hào)。
電可擦除的PROM器件是()
27系列EPROM存儲(chǔ)的數(shù)據(jù)是()可擦除的。
基本RS觸發(fā)器的輸入直接控制其輸出狀態(tài),所以它不能被稱為()觸發(fā)器。
()在計(jì)算機(jī)系統(tǒng)中得到了廣泛的應(yīng)用,其中一個(gè)重要用途是構(gòu)成數(shù)據(jù)總線。
如要將一個(gè)最大幅度為5.1V的模擬信號(hào)轉(zhuǎn)換為數(shù)字信號(hào),要求輸入每變化20mV,輸出信號(hào)的最低位(LSB)發(fā)生變化,應(yīng)選用()位ADC。
7系列EPROM存儲(chǔ)的數(shù)據(jù)是()可擦除的。
一個(gè)兩輸入端的門電路,當(dāng)輸入為10時(shí),輸出不是1的門電路為()