A.速度快高
B.電路簡單
C.振蕩頻率穩(wěn)定
D.輸出波形邊沿陡峭。
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A.正弦波
B.矩形波
C.三角波
D.鋸齒波
A.多諧振蕩器
B.石英晶體振蕩器
C.施密特觸發(fā)器
D.555定時器
A.10
B.60
C.525
D.31500
A.1
B.6
C.8
D.10
A.1
B.2
C.4
D.8
A.3
B.4
C.5
D.10
A.沒有觸發(fā)器
B.沒有統(tǒng)一的時鐘脈沖控制
C.沒有穩(wěn)定狀態(tài)
D.輸出只與內(nèi)部狀態(tài)有關(guān)
A.N-1
B.N
C.N+1
D.2N
A.變量譯碼器
B.加法器
C.數(shù)碼寄存器
D.數(shù)據(jù)選擇器
A.4
B.5
C.9
D.20
最新試題
TTL與非門輸入短路電流IIS的參數(shù)規(guī)范值是()。
以下哪個編碼不能是二-十進(jìn)制譯碼器的輸入編碼()
小容量RAM內(nèi)部存儲矩陣的字?jǐn)?shù)與外部地址線數(shù)n的關(guān)系一般為()
兩個與非門構(gòu)成的基本RS觸發(fā)器,當(dāng)Q=1、Q=0時,兩個輸入信號R=1和S=1。觸發(fā)器的輸出Q會()。
什么是觸發(fā)器的空翻現(xiàn)象,如何避免空翻?
一個VHDL模塊是否必須有一個實(shí)體和一個結(jié)構(gòu)體?是否可以有多個實(shí)體和結(jié)構(gòu)體?簡述它們的作用。
一個兩輸入端的門電路,當(dāng)輸入為10時,輸出不是1的門電路為()
與倒T形電阻網(wǎng)絡(luò)DAC相比,權(quán)電流網(wǎng)絡(luò)D/A轉(zhuǎn)換器的主要優(yōu)點(diǎn)是消除了()對轉(zhuǎn)換精度的影響。
用原碼輸出的譯碼器實(shí)現(xiàn)多輸出邏輯函數(shù),需要增加若干個()。
以下代碼中為無權(quán)碼的為()。